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MR0A08B
BLOCK DIAGRAM AND PIN ASSIGNMENTS
Figure 1 – MR0A08B Block Diagram
G
OUTPUT
ENABLE
BUFFER
OUTPUT ENABLE
A[16:0]
17
ADDRESS
BUFFER
7
10
ROW
DECODER
COLUMN
DECODER
E
CHIP
ENABLE
BUFFER
128k x 8
8
SENSE
AMPS
8
OUTPUT
BUFFER
8
BIT
W
WRITE
ENABLE
BUFFER
MEMORY
ARRAY
8
FINAL
WRITE
DRIVERS
8
WRITE
DRIVER
8
DQ[7:0]
WRITE ENABLE
Table 1 – Pin Functions
Signal Name
A
E
W
G
DQ
V DD
V SS
DC
NC
Function
Address Input
Chip Enable
Write Enable
Output Enable
Data I/O
Power Supply
Ground
Do Not Connect
No Connection - Pin 2, 40, 41,43 (TSOP2); Ball C2, C5, D3, F2, F5, G1, G2, G6, H1, H6
(BGA); Pin 30 (SOIC) Reserved For Future Expansion
Copyright ? 2013 Everspin Technologies
4
MR0A08B Rev. 8, 10/2013
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